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[1]
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SCI
[1]
CPCI-S
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EI
[2]
学校署名
第一
[3]
通讯
[2]
重要成果
作者
贺林君
[1]
黄晨雨
[3]
王利丹
[3]
ESI学科分类
期刊来源
14TH IEEE ASIA P...
[1]
2018 IEEE ASIA P...
[1]
IEEE TRANSACTION...
[1]
语种
英语
[1]
全文
无全文
[3]
来源库
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[1]
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资助机构
资助项目
National Natural Science Foundation of China[...
[1]
National Natural Science Foundation of China[...
[1]
Shenzhen Science and Technology Innovation Co...
[1]
Shenzhen Science and Technology Innovation Co...
[1]
[JCYJ20160530191008447]
[1]
专利状态
发表年份
2018
[3]
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[1]
A Chip-Area-Efficient Subthreshold CMOS Voltage Reference with High PSRR Based on Compensated Δv
GS
of NMOS Transistors
来源：
14th IEEE Asia Pacific Conference on Circuits and Systems, APCCAS 2018, Chengdu, China, 26-30 Oct. 2018
作者：
Lei, Yu
;
Zhan, Chenchang
;
Huang, Chenyu
;
Wang, Lidan
浏览/下载:
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0
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会议论文
EI
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[2]
A 0.6-V Minimum-Supply, 23.5 ppm/°C Subthreshold CMOS Voltage Reference With 0.45% Variation Coefficient
来源：
IEEE Transactions on Circuits and Systems II: Express Briefs, 2018, 卷号: 65, 期号: 10, 页码: 1290-1294
作者：
Huang, Chenyu
;
Zhan, Chenchang
;
He, Linjun
;
Wang, Lidan
;
Nan, Yang
浏览/下载:
19/0
被引[WOS]:
30
被引[Scopus]:
32
影响因子:
0.0
期刊论文
SCI
CPCI-S
EI
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[3]
A Chip-Area-Efficient Subthreshold CMOS Voltage Reference with High PSRR Based on Compensated. VGS of NMOS Transistors
来源：
2018 IEEE ASIA PACIFIC CONFERENCE ON CIRCUITS AND SYSTEMS (APCCAS 2018)
作者：
Lei, Yu
;
Zhan, Chenchang
;
Huang, Chenyu
;
Wang, Lidan
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会议论文
CPCI-S
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